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什么是同步逻辑和异步逻辑,同步电路和异步电路的区别是什么？


  同步逻辑是时钟之间有固定的因果关系。异步逻辑是各时钟之间没有固定的因果关系。

  步进电机电路设计可分类为同步电路和异步电路设计。

  同步电路利用时钟脉冲使其子系统同步运作，而异步电路不使用时钟脉冲做同步，其子系统是使用特殊的“开始”和“完成”信号使之同步。由于异步电路具有下列优点--无时钟歪斜问题、低电源消耗、平均效能而非最差效能、模块性、可组合和可复用性--因此近年来对异步电路研究增加快速，论文发表数以倍增，而Inb Pentium 4处理器设计，也开始采用异步电路设计。 
异步电路主要是组合逻辑电路，用于产生地址译码器、ＦＩＦＯ或ＲＡＭ的读写控制信号脉冲，其逻辑输出与任何时钟信号都没有关系，译码输出产生的毛刺通常是可以监控的。同步电路是由时序电路(寄存器和各种触发器)和组合逻辑电路构成的电路，其所有操作都是在严格的时钟控制下完成的。这些时序电路共享同一个时钟ＣＬＫ，而所有的状态变化都是在时钟的上升沿(或下降沿)完成的。

  步进电机异步电路重要是组合逻辑电路，用于产生天址译码器、FIFO或RAM的读写节制信号脉冲，但它同时也用在时序电路中，彼时它出有统一的时钟，状态变化的时辰是不稳定的，通常输入信号只在电路处于波动状态时才发作变化。也就是说一个时辰容许一个输入产生变化，以防止输入信号之间形成的竞让冒险。电路的稳定需求有可靠的建立时间和持时间，待上面引见。

  步进电机同步电路是由时序电路(寄存器和各种触发器)和组合逻辑电路形成的电路，其一切操作都是在严厉的时钟掌握下完成的。这些时序电路同享统一个时钟CLK，而一切的状态变化都是在时钟的上升沿(或降落沿)完成的。比如Ｄ触发器，当上升延到来时，寄存器把Ｄ端的电平传到Ｑ输出端。

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